同时存在。两种类型的电路都作为输入时，为避免毛刺现象，可以在组合逻辑的输入之前加Ｄ触发器，以将组合逻辑电路转化为时序电路。在多级时钟系统中，为了满足建立和保持时间的要求，往往需要在低频时钟信号驱动的逻辑电路的输出端加一级高频时钟信号驱动的Ｄ触发器，以实现时钟之间的同步。但这样做会增加输入和输出之间的时间延迟，严重时可能通不过编译软件的时序验证。因此，可以将其转化为简单的组合逻辑电路，以使其比较容易实现。

４　结束语

该方案已经通过了实验验证，测量结果能够满足设计要求。考虑到成本问题，选择的芯片不能与５Ｖ系统直接相连，这使得多路输入信号给整个电路的设计带来了一定的困难。如果排除这些因素，该方案还可以得到进一步的改善。