动态扫描电路中小数点的显示无法在译码电路中完成。由于小数点的位置是固定的，因此可由计数器提供的同步信号产生另一信号控制DP。VHDL程序实现如下：

if (count：“101”or count=“001”)then data(0)<＝‘1’；

else data(0)<＝‘0’；

end if；

显示模块(以下简称SHOW)封装见图4。此模块中应用了两个过程，在过程内程序顺序执行，其中第一个过程触发第二个过程。

3 系统综合

3．1 模块联调

各个功能子模块设计完成后，利用MAXPLUSⅡ的图形编辑器(Graphic Editor)将各功能子模块(．sym)进行连接。由于MILE模块中存在毛刺，故不能直接与后级相连，通过对输出脉冲信号加门电路延时，再与原始信号相“与”的方法即可消除毛刺。系统顶层原理图如图4所示。

芯片管脚定义可以直接用编辑．pin文件或在Floor—Plan Editor下进行。完成管脚定义后选择器件(EPM7128SIC84—15)，编译后生成．sof、．pof及报告文件．rpt。查看报告文件可得到器件管脚的利用情况及器件内部资源的使用情况。通过更换适当的器件使其资源配置达到最优。选择器件的一般原则是系统所使用的资源不要超过器件资源的80％，若超过90％，系统功耗将增大，工作不稳定。从本次设计器件部分报告中得知：输入、输出管脚各用16只，芯片资源利用率仅为51％，具有较大的扩展空间。

图4

    3．2 硬件设计说明

本次设计的出租车计费器计数脉冲CP来自车轮转速传感器(干簧管)，脉冲经器件内部整形后送计数器；动态扫描脉冲由外围电路给出；系统使用整流、滤波、降压后的出租车电源供电；由于CPLD／FPGA的驱动能力有限，为了增强数码管的亮度，提高系统的可靠性，设计中在LED驱动和位驱动上分别增加了电流驱动器件ULN2803和2SCl015。

现场实验表明：该计费器实现了按预制参数自动计费(最大计费金额为999．9元)、自动计程(最大计程公里数为999．9公里)等功能；能够实现起步价、每公里收费、车型及加费里程的参数预制(如：起步价5．00元；3公里后，1．20元／公里；计费超过15．00元，每公里加收50％的车费等)，且预置参数可调范围大。由于采用了CPLD／FPGA大规模可编程逻辑器件，整机功耗小、抗干扰能力强、系统稳定、工作可靠、升级方便。另外，根据实际需要，系统可方便地增加以下功能：①通过芯片内部编程增加时钟功能(器件内部资源足够)，既可为司机和乘客提供方便，又能为夜间行车自动调整收费标准提供参考；②用CPLD／FPGA的输出引线控制语音芯片，可向乘客发出问候语、提醒乘客告诉司机所要到达的地点、报出应收缴的费用等。